簡單也是另一種快樂 :: 痞客邦 ::

May 10 Thu 2012 16:40
陣列 (Array) 表示法

Abstract

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個人分類：Verilog HDL

Apr 01 Sun 2012 17:22
串列傳輸設計(UART Design by Verilog language)

UART Protocol Introduction

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個人分類：Verilog HDL

Apr 01 Sun 2012 14:02
串列傳輸通訊協定(UART Protocol)

UART Protocol Introduction

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個人分類：有趣新事物

Apr 01 Sun 2012 13:41
定點數運算(Fixed Point)

定點數運算(Fixed Point)

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個人分類：有趣新事物

Apr 01 Sun 2012 13:33
鮑率(Baud Rate)是什麼?

鮑率(Baud Rate)

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個人分類：有趣新事物

Mar 11 Sun 2012 16:20
Wire與reg的差異性?

Abstract

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個人分類：Verilog HDL

Feb 28 Tue 2012 17:36
比較RS-232 & RS-485

簡介RS-232 & RS-485

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個人分類：有趣新事物

Feb 27 Mon 2012 18:14
階層式設計

階層式設計

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個人分類：Verilog HDL

Feb 27 Mon 2012 18:12
if - else條件敘述

If-else條件敘述

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個人分類：Verilog HDL

Feb 25 Sat 2012 21:42
美國佛羅里達州奧蘭多

APEC 2012 (The Applied Power Electronics Conference and Exposition)

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